98 lines
3.1 KiB
ArmAsm
98 lines
3.1 KiB
ArmAsm
.text
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.align 2
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.global _start
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_start:
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//preload U-Boot from sd
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ldr r4, .L3
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adr r1, [.LC0]
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adr r0, [.LC1]
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mov r3, r4
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blx r3
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add r5, r4, #0xc
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mov r3, r0
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ldr r0, .L3+4
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mov r1, #1
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mov r2, r0
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blx r5
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cpsid if
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//copy U-Boot to head of RAM
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ldr r3, =0x37500000
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ldr r1, =0x37540000
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.L2:
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mov r2, r3
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sub r3, r3, #0x7500000
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ldr r0, [r2], #4
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cmp r2, r1
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str r0, [r3]
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mov r3, r2
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bne .L2
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ldr r0, =0x60000000
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//MUB Interrupt Disable
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ldr r2,=0x40220064
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ldr r3,[r2]
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ldr r1,=0x0000ffff
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and r3,r3,r1
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str r3,[r2]
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mrc p15, 0, r8, c14, c2, 1
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bic r8, r8, #1
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mcr p15, 0, r8, c14, c2, 1
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mrc p15, 0, r8, c14, c3, 1
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||
bic r8, r8, #1
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||
mcr p15, 0, r8, c14, c3, 1
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mov r9, #0
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mrc p15, 0, r6, c1, c0, 0
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bic r6, r6, #4 @ disable dcache
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bic r6, r6, #4096 @ disable icache
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mcr p15, 0, r6, c1, c0, 0 // write ctrl regs
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mcr p15, 0, r9, c7, c5, 0 // invalidate icache
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// from: https://www.aps-web.jp/academy/ca/229/#i-2
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mov r10,#0 // データキャッシュを選択
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mcr p15,2,r10,c0,c0,0 // キャッシュサイズ選択レジスタ（CSSELR）で
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// データキャッシュを選択
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isb // 命令同期バリア命令で再フェッチ
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mrc p15,1,r1,c0,c0,0 // CCSIDRを読み込み
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and r2,r1,#7 // キャッシュラインサイズを取得（b001=8ワード/ライン）
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add r2,r2,#4 // DCISWレジスタのセット番号のシフト数を求める
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ldr r4,=0x3FF // 最大ウェイ数マスク設定値を設定
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ands r4,r4,r1,LSR #3 // r4レジスタにウェイ数を設定
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clz r5,r4 // DCISWレジスタのウェイ番号のシフト数を求める
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ldr r7,=0x7FFF // セット数マスク設定値を設定
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ands r7,r7,r1,LSR #13 // r7レジスタにセット数を設定
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// 0x7F=12Kbyte/0xFF=32Kbyte/0x1FF=64Kbyte
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loop2:
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mov r9,r4 // r9レジスタにウェイ数を設定
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loop3:
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orr r11,r10,r9,LSL r5 // ウェイ番号とキャッシュ番号を設定
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orr r11,r11,r7,LSL r2 // セット番号を設定
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mcr p15,0,r11,c7,c6,2 // DCISWレジスタでセット/ウェイによる
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// データキャッシュラインの無効化
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subs r9,r9,#1 // ウェイ番号を-1
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bge loop3 // ウェイ毎の初期化を実施
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subs r7,r7,#1 // セット番号を-1
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bge loop2 // セット毎の初期化を実施
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mcr p15, 0, r9, c8, c7, 0 // invalidate TLB
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mcr p15, 0, r9, c7, c5, 6 // invalidate branch predictor array
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bic r6, r6, #1 @ disable MMU
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mcr p15, 0, r6, c1, c0, 0 // write ctrl regs
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bx r0
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.L3:
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.word 0x60006400
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.word 0x37500000
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.LC0:
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.ascii "r\000"
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.LC1:
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.ascii "SD0:\\u-boot.bin\000"
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